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PCIe4.0推出后，不到2年就發(fā)布了PCIe5.0規(guī)范。根據(jù)市場(chǎng)的發(fā)展，對(duì)I/O帶寬的需求每三年就會(huì)翻一番，所以PCIe5.0是一個(gè)早就該有的規(guī)范。目前PCI-SIG的工作只是在補(bǔ)進(jìn)度。得益于PCI-SIG的努力，今年5月正式推出了PCIe5.0規(guī)范，出現(xiàn)了很多設(shè)計(jì)插件，終端產(chǎn)品有望在2020年陸續(xù)推出。與PCIe4.0相比，PCIe5.0的性能提高了一倍，信號(hào)速率達(dá)到32Gb/s，單通道帶寬提高到32GB/2，x16帶寬提高到128GB/s，保持向后兼容(支持4.0~1.0)。

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PAM-4技術(shù)的使用是一個(gè)新的進(jìn)展，但它還在討論之中，并且通過0.3版的發(fā)布，還將從會(huì)員的發(fā)展中獲得更多的反饋，并相應(yīng)地進(jìn)行調(diào)整，如果會(huì)員的反饋不理想，終還是有可能改變的。然而，速度的持續(xù)倍增并非全無(wú)缺點(diǎn)，首當(dāng)其沖的，是給系統(tǒng)設(shè)計(jì)者帶來(lái)更大的壓力，不僅需要在整個(gè)系統(tǒng)規(guī)劃中投入更大的心力，才能在速度和穩(wěn)定之間尋求平衡。而且在開發(fā)后期的測(cè)試和驗(yàn)證中，所需的費(fèi)用也會(huì)比較大。

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眾所周知，消費(fèi)者級(jí)桌面處理器上的CPU直連PCIe通道非常有限，以目前的主流處理器來(lái)看，Intel十代酷睿旗艦i910900K目前只有16個(gè)直連PCIe通道，而AMD第三代銳龍旗艦銳龍93900X有20個(gè)直連PCIe通道。直接出口通道的數(shù)目決定了與處理器高速連接的設(shè)備的數(shù)目。

在Intel平臺(tái)上，當(dāng)這個(gè)直連處理器的PCIe×16插槽上只插入一個(gè)顯卡時(shí)，可以達(dá)到PCIe3.0×16的全速，但是如果使用雙顯卡SLI或CFX，只能使用8 8通道，而當(dāng)三個(gè)PCIe設(shè)備連接時(shí)，只能分配到8 4 4 4通道，在PCIe通道數(shù)量有限的情況下，多個(gè)PCIe設(shè)備連接的速度會(huì)降低，當(dāng)多個(gè)PCIe設(shè)備連接時(shí)，無(wú)法發(fā)揮全部性能。